導語：本文在詳細闡述梯形波脈寬調(diào)制（TPWM）控制算法的基礎上，以Altera FPGA為控制核心，提出來一種用Verilog HDL語言分別實現(xiàn)各功能模塊，生成可調(diào)的三相全數(shù)字TPWM波的方法，避免了傳統(tǒng)的先定制數(shù)據(jù)ROM，從而也提升系統(tǒng)反應速度。
本文在詳細闡述梯形波脈寬調(diào)制（TPWM）控制算法的基礎上，以Altera FPGA為控制核心，提出來一種用Verilog HDL語言分別實現(xiàn)各功能模塊，生成可調(diào)的三相全數(shù)字TPWM波的方法，其中采用直接寫函數(shù)產(chǎn)生三相梯形波，避免了傳統(tǒng)的先定制數(shù)據(jù)ROM，再查表生成波形的復雜過程，從而也提升系統(tǒng)反應速度。實驗結果表明該設計具有結構靈活、易修改、諧波少等優(yōu)點，為該技術下一步的應用和推廣提供了一個良好的開放平臺。
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